Debug via JTAG

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Ciao a tutti,
Volevo condividere con voi un bel tool che ho trovato (gratuito per 20 giorni) per fare debug tramite JTAG anche su CPLD (non supportati da SignalTap II che è gratuito di Altera), ovvero osservare il valore dei pin senza collegare un probe su ogni pin:
http://www.topjtag.com/probe/

Purtroppo ho notato che è possibile impostare la scala temporale ad un massimo di 493.2 us, il che lo rende utile solo per segnali abbastanza lenti.. ma forse è una limitazione della banda disponibile tramite JTAG.

Per chi volesse provare il tool è necessario scaricare il file BSDL (o generarlo tramite Quartus II) della scheda sotto debug
http://www.altera.com/download/board-la ... 11491.html

Ciao a tutti

NB: Sulle FPGA e CPLD supportate il tool re è SignalTap II

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Ho provato anche SignalTap II sulla DE0-Nano con un Cyclone IV a bordo e devo dire che.. non c'è confronto! Sono rimasto impressionato da quanto può essere utile!

Mi sembra che è possibile vedere segnali a tutte le frequenze (ho provato con 50 MHz) senza problemi, ci sono opzioni di Trigger, Numero dei Samples, etc.. una sorta di analizzatore di stati logici virtuale!

Ho dovuto però, a differenza di TopTag, ricompilare e ricaricare il progetto sulla FPGA dopo aver impostato SignalTap, ho notato anche che SignalTap mi ha preso 491 LE, nulla di che visto che la FPGA ha ancora molte risorse.

TopTag non richiede il ricaricamento del progetto e potrebbe essere utile "in produzione" per vedere segnali non velocissimi laddove non c'è un vero analizzatori di stati e si vuole fare una verifica veloce

Ciao